| Numéro | 52243 | Date | 25-08-2006 |
| Mobilité | PACA | Ville | ELANCOURT plan : |
| Nom | ESTEREL TECHNOLOGIES | Secteur d'activité | Indifférent |
| nb salariés | 140 | Type de contrat | CDI |
| Fonction | INGENIEUR VALIDATION HW | Type de formation | indifférent |
| Expérience | 1ans | Salaire | De 31 à 38 KEuros |
| Pays | France | Langue 1 | Anglais courant |
| Site Internet | http://www.esterel-technologies.com | Langue 2 | Français |
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Ingénieur Validation Hardware MODELSIM
ESTEREL TECHNOLOGIES est l’éditeur des environnements de développement de logiciels embarqués et de systèmes électroniques SCADE et Esterel Studio. Ces produits sont utilisés par de nombreux grands comptes des secteurs de l’Aérospatial & Défense, Automobile, Semi-conducteur et Electronique grand public, Télécommunications.
Description du Poste
Vous intervenez au sein d’une équipe spécialisée dans la conception et le design numérique ainsi que la validation fonctionnelle Top Level de « System On Chip » pour le domaine de la téléphonie mobile.
Profil du candidat
Ingénieur grandes écoles ou universitaire en Micro Electronique.
Minimum 2 à 4 ans d’expérience.
Compétences et expérience requises
Expérience en Validation Top Level de SOC/ASIC.
Simulation fonctionnelle RTL sous Modelsim.
Connaissance utilisateur de l’outil Specman et des eVCs.
Connaissances des langages VHDL et Verilog.
Maîtrise de la langue Anglaise.
Goût pour le travail en équipe.
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